发布时间 : 星期五 文章数字逻辑试卷2007(计算机学院A)更新完毕开始阅读9ce327b63968011ca2009153
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电子科技大学二零零七至二零零八学年第1学期期末考试
数字逻辑 课程考试题 卷 （ 120 分钟） 考试形式： 闭卷 考试日期 2007年 12 月 29 日
课程成绩构成：平时 20 分， 期中 10 分， 实验 0 分， 期末 70 分
一
二 三 四 五 六 七 八 九 十 合计 一、单项选择题，下列每题的四个选项中有一个正确的，请把正确选项的编号填入括号内（每小题2分，共10分）
1、某符号二进制数补码为11010,其原码为( (4) )。 (1) 01010 (2) 11010 (3) 10101 (4) 10110
2、F(A,B,C,D)?ABD?BC,它包含的最小项个数是( (1) ) (1) 5个 (2) 6个 (3) 7个 (4) 8个
3、下列编码是有效8421BCD码的是( (2) )。
(1) 1111 (2) 1001 (3) 1010 (4) 1100 4、A+BC=( (3) )。
(1) A+B (2) A+C (3)(A+B)(A+C) (4) B+C 5、F?A?(A?B)?（ (2) ）
(1) A (2) B (3)A?B (4) A?B 二、填空题（每小题2分，共10分）
1、当i?j时，同一逻辑函数的两个最小项mi?mj?（ 0 ）。 2、逻辑函数F?A?B?CD的反函数F?（ BA(D?C) ）。 3、逻辑函数F?A(B?C)?1的对偶函数是F??（ A+BC ）。 4、推拉输出结构的逻辑门（ 不能 ）将输出端直接连接，实现线与输出。 5、集电极开路（OC）输出门的输出端必须外接（ 电阻 ）。 三、判断题，请在下面正确描述的前面打√，在错误描述前面打×（每小题2分，10分）
（ F ）1、TTL与非门的不用输入端不能悬空，悬空时，相当于逻辑“0”电平。 （ T ）2、由与非门构成的基本RS触发器的约束条件是S?R?0。
（ T ）3、主从JK触发器的J、K端，若在CP为“1”期间发生了变化，则看作“1”。 （ F ）4、主从RS触发器已没有约束条件。
（ F ）5、格雷码的特点是任意二个相邻码组间只有2位发生变化。 四、化简题（每小题4分，共12分）
1、用卡诺图化简下列函数为最简或与式 F(A,B,C,D)??M(0,1,2,3,5,6,7,10,14,15)
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2、用卡诺图化简下列函数为最简与或式
F(A,B,C,D)?A?B?C?BCD?AB?BCD?CD?AB?ABC
3、用代数法化简下列函数
F(A,B,C,D,E)?ABC?ABCDE?A?B?C
五、判断下列电路是否存在险象。如果存在险象，请消除之，并画出电路(8分)。判断2分，消除4分，电路2分。
六、试用或非门实现下列逻辑函数。（6分）写出正确的函数式4分，画出电路2分。 F?(A?B)?(B?C)
七、一位全加器的真值表如下，请用译码器74LS138（输出低电平有效）和与非门实现之，
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画出电路图。（6分）写出函数式4分，画出电路图2分。
八、一位全加器的真值表同上，请用两个4选1数据选择器实现其功能。（6分）画出卡诺图2分，写出函数式2分（或根据真值表直接写出函数式也得4分），画出电路图2分。
八、由D触发器和逻辑门构成的电路如下所示，试根据输入波形和CP画出W和Z的波形。设触发器Q端起始状态为0。（6分）W波形3分，Z波形3分。
九、下图是利用74LS161异步清零端构成的计数器电路，试判断电路实现几进制计数？并画出时钟和各Q端的波形（设计数器起始状态为0000）。（6分）判断2分，画波形4分。
十、请用JK型触发器设计一个 同步5进制加法计数器。要求：画出原始状态图，状态表，求出输出方程，激励方程，画出电路图。（10分）每步2分。
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十一、试根据下列波形用D触发器设计一个异步5进制加法计数器。（10分）写出时钟方程2分，真值表4分，激励方程和输出方程2分，电路图2分。
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